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dtlab_t5 [2024/04/08 11:29] beckmanf [HEX3 und HEX2 für Summand sa] |
dtlab_t5 [2025/03/14 20:40] (current) beckmanf switch code server |
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| ==== VHDL toplevel top_hex ==== | ==== VHDL toplevel top_hex ==== | ||
| - | In der Datei [[https://gitlab.elektrotechnik.hs-augsburg.de/beckmanf/dtlab/-/blob/master/src/top_hex.vhd|top_hex.vhd]] ist die höchste Hierarchie (toplevel) auf dem FPGA mit den Eingängen SW und den Ausgängen LEDR, HEX0, HEX1, HEX2, HEX3 dargestellt. | + | In der Datei [[https://caeis.etech.fh-augsburg.de/beckmanf/dtlab.git/tree/src/top_hex.vhd|top_hex.vhd]] ist die höchste Hierarchie (toplevel) auf dem FPGA mit den Eingängen SW und den Ausgängen LEDR, HEX0, HEX1, HEX2, HEX3 dargestellt. |
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| ==== Instantiierung von bin2seg ==== | ==== Instantiierung von bin2seg ==== | ||
| - | In top_hex ist die Schaltung "bin2seg" aus der Datei [[https://gitlab.elektrotechnik.hs-augsburg.de/beckmanf/dtlab/-/blob/master/src/bin2seg.vhd|bin2hex.vhd]] zweimal instantiiert. | + | In top_hex ist die Schaltung "bin2seg" aus der Datei [[https://caeis.etech.fh-augsburg.de/beckmanf/dtlab.git/tree/src/bin2seg.vhd|bin2hex.vhd]] zweimal instantiiert. |
| <html> | <html> | ||